Parallele Datenübertragung

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Parallele und serielle Datenübertragung im Vergleich

Parallele Datenübertragungen übertragen digitale Daten über mehrere Leitungen gleichzeitig. Die Übertragung erfolgt dabei auf mehreren physischen Leitungen nebeneinander oder über mehrere Kanäle zur gleichen Zeit im "Gleichschritt". Werden nur binäre Symbole mit zwei möglichen Zuständen eingesetzt, entspricht ein Symbol einem Bit, welches pro Datenpfad übertragen werden kann. Bei n parallelen Datenpfaden können n Bits in einem Schritt parallel übertragen werden.

Die parallele Übertragung über mehrere serielle Datenkanäle unterscheidet sich grundlegend von einer parallelen Datenübertragung in der Weise, dass dort auf der unteren Hardwareebene alle Kanäle unabhängig voneinander übertragen und Laufzeitunterschiede irrelevant sind. Bei parallelen Übertragungen arbeiten alle Datenkanäle streng mit einem gemeinsamen Taktregime und sind dadurch sehr empfindlich auf Laufzeitunterschiede der Kanäle.

Allgemeines

Parallele Schnittstellen arbeiten in den meisten Fällen mit 8 oder 16 Kanälen. Prinzipiell ist jede andere Zahl größer als 1 möglich. Zur Synchronisation sind zusätzliche Leitungen notwendig. Meist sind das Leitungen zur Datenflusskontrolle oder zur Synchronisation (Strobe, Taktsignale).

Eine Umsetzung zwischen der parallelen und der seriellen Datenübertragung kann mittels spezieller Baugruppen, welche als SerDes bezeichnet werden, erfolgen.

Nachteil

Datei:DDR2 RAM PC5300 MatchedBusLines.jpg
DDR3-Speichermodule, bei denen zwischen dem Printstecker und den Speicherchips die mäanderförmig geführten Leiterbahnen zur Laufzeitkorrektur der Bussignale erkennbar sind

Der wesentliche Nachteil der parallelen Datenübertragung, neben dem Umstand, eine Vielzahl von parallelen Datenübertragungspfaden zu benötigen, ist der Umstand, dass die einzelnen Laufzeiten entlang der parallelen Leitungen nicht alle exakt gleich sind. Diese Ungleichheiten können beispielsweise durch kleine Abweichung in den Leitungslängen und anderen Toleranzen im physikalischen Aufbau der Übertragungsstrecke bedingt sein. Dadurch kommt es, insbesondere bei höheren Schrittgeschwindigkeiten, zu Empfangsfehlern bzw. einer Beschränkung der Schrittgeschwindigkeit und damit der Datenübertragungsrate. Aus diesem Grund werden bei höheren Übertragungsraten serielle Übertragungsverfahren eingesetzt, auch wenn durch die serielle Aneinanderreihung der einzelnen Symbole hohe Symbolraten und große Bandbreiten die Folge sind.

In diesem Fall wird durch mäanderförmig gestaltete Leiterbahnführungen auf den Leiterplatten versucht, eine möglichst identische Laufzeit zwischen den einzelnen Signalen sicherzustellen. Die Mäanderform dient dazu, dass alle Leiterbahnen fast exakt die gleiche Länge zueinander aufweisen. Zusätzlich kommen in den einzelnen Schaltkreisen, wie den DDR-SDRAM-Chips, Delay-Locked Loops (DLL) zur Anwendung, welche Laufzeitunterschiede dynamisch ausgleichen und so eine parallele Datenübertragung bei hohen Taktraten sicherstellen.[1]

Beispiele für durch serielle Schnittstellen abgelöste parallele Datenübertragungen ist die SATA-Schnittstelle, die die ATA/ATAPI-Schnittstelle wie auch PCI-Express, der PCI ablöste, oder Fibre Channel als Weiterentwicklung der parallelen SCSI-Busvarianten. Trotz drastischer Reduzierung der Übertragungsleitungen wurden die Bussysteme dabei um etwa den Faktor 2 schneller.

Literatur

  • Dietmar Lochmann: Digitale Nachrichtentechnik. 2. Auflage. Verlag Technik Berlin, 1997, ISBN 3-341-01184-6.
  • Roland Hellmann: Rechnerarchitektur. Einführung in den Aufbau moderner Computer, 2. Auflage, de Gruyter Verlag, Berlin / Boston 2016, ISBN 978-3-11-044605-0.
  • Thomas Flik: Mikroprozessortechnik und Rechnerstrukturen. 7. Auflage. Springer Verlag, Berlin / Heidelberg 2005, ISBN 3-540-22270-7.
  • Ekbert Hering, Klaus Bressler, Jürgen Gutekunst: Elektronik für Ingenieure und Naturwissenschaftler. Springer Verlag, Berlin/ Heidelberg 2014, ISBN 978-3-642-05499-0.
  • Hans Liebig: Rechnerorganisation. Die Prinzipien, 3. Auflage, Springer Verlag, Berlin / Heidelberg 2003, ISBN 978-3-540-00027-3.

Einzelnachweise

  1. DDR Interface Design Implementation. Lattice Semiconductor, 2004, abgerufen am 4. März 2014.

Weblinks